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Type: Dissertação
Title: Geração de código otimizado visando a exploração de paralelismo na arquitetura IPNoSys
Authors: Couto, Juliene Vieira do
First Advisor: Araújo, Silvio Roberto Fernandes de
First member of the board: Moura, Raimundo Santos
Second member of the board: Queiroz, Paulo Gabriel Gadelha
Third member of the board: Castro, Angélica Félix de
Resume: As arquiteturas paralelas necessitam de código otimizado que explore seus novos recursos. Algumas arquiteturas seguem o paradigma da máquina de Von Neumann, enquanto que outras divergem desse modelo, um exemplo é o processador IPNoSys. Esse processador foi baseado em redes-em-chip e apresenta um modelo de computação dirigido a pacotes o que reflete no seu modelo de programação. Inicialmente, essa arquitetura possuía um montador e um simulador e necessitava de um compilador. Em trabalhos posteriores compiladores para a IPNoSys foram desenvolvidos, mas nenhum explorou completamente as características dessa arquitetura. Com isso, o objetivo deste trabalho é definir uma etapa de otimização de código no compilador IPNoSys, considerando características não exploradas como o paralelismo e melhorando seu código gerado. O módulo de otimização oferece três níveis de otimização. A fim de avaliar o módulo criado, efetuou-se uma comparação do tempo de execução e do tamanho dos códigos gerados nos três níveis de otimização. Foi obtido que um nível de otimização apresentou melhor tempo de execução, porém gerou aplicações com um maior tamanho, enquanto que outro nível apresentou um menor tamanho. Além disso, houve uma melhoria nos códigos gerados
Abstract: Parallel architectures require optimized code that exploits its new features. Some architectures follow the paradigm of Von Neumann machine, while others differ from this model, such as IPNoSys processor. This processor is based on network-on-chip and features a package-driven computer model driven which reflects in its programming model. Initially, this architecture had an assembler and a simulator and needed a compiler. In later papers compilers for IPNoSys have been developed, but none fully explored the features of this architecture. Thus, the objective of this paper is to define a code optimization step in IPNoSys compiler, considering characteristics unexploited as parallelism and improving your generated code. The optimization module offers three levels of optimization. In order to evaluate the created module, made a comparison of the execution time and the size of codes generated in the three levels of optimization. It was obtained that an optimization level showed better run time, but generated applications with a larger size, while another level showed a smaller size. Furthermore, there was an improvement in the generated code
Keywords: Arquiteturas paralelas
Compilador
IPNoSys
Otimização
Nível de otimização
Parallel archtectures
Compiler
IPNoSys
Optimization
Levels of Optimization
CNPq: CNPQ::CIENCIAS EXATAS E DA TERRA::CIENCIA DA COMPUTACAO
Language: por
Country: Brasil
Publisher: Universidade Federal Rural do Semi-Árido
Institution Initials: UFERSA
Program Name: Programa de Pós-graduação em Ciência da Computação
Citation: COUTO, Juliene Vieira do. Geração de código otimizado visando a exploração de paralelismo na arquitetura IPNoSys. 2016. 112 f. Dissertação (Mestrado) - Curso de Pós-graduação em Ciência da Computação, Universidade Federal Rural do Semi-Árido, Mossoró, 2016.
Access Type: Acesso Aberto
URI: https://repositorio.ufersa.edu.br/handle/tede/652
Issue Date: 9-Sep-2016
License Term: CC-BY-SA
Appears in Collections:Mestrado em Ciência da Computação

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